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集成電路布局的檢驗(yàn)方法技術(shù)資料下載

技術(shù)編號:6461468

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本發(fā)明是有關(guān)于一種,特別是關(guān)于一種設(shè)計(jì)規(guī)則 檢査和布局與圖式規(guī)則檢査。背景技術(shù)隨著集成電路技術(shù)的發(fā)展,計(jì)算機(jī)輔助設(shè)計(jì)(CAD)系統(tǒng)尤其是電子設(shè)計(jì)自 動化(EDA)技術(shù)是日益被運(yùn)用到半導(dǎo)體集成電路的設(shè)計(jì)中。在實(shí)際生產(chǎn)制造集成電路芯片前, 一般會以審査軟件進(jìn)行檢査,確認(rèn)此集 成電路的設(shè)計(jì),符合將要用以生產(chǎn)制造此一芯片的工藝的要求與限制,包括確 認(rèn)此集成電路實(shí)體設(shè)計(jì)的布局相符于其圖式的設(shè)計(jì),這些都是在實(shí)際制造一電 路前非常重要的步驟。有了這些確認(rèn)的程序,由指定工...
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