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具有雙邊沿時鐘的集成電路的制作方法技術(shù)資料下載

技術(shù)編號:6360851

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本申請要求2010年6月11日提交的美國專利申請12/814344的優(yōu)先權(quán)和利益。背景技術(shù)脈沖鎖存器是由時鐘脈沖信號控制的電平敏感鎖存器(S卩,在時鐘脈沖信號的某些相位中使能電平敏感鎖存器)。時鐘脈沖信號通常由方波時鐘信號(即,具有50%占空比的時鐘信號)使用脈沖發(fā)生器生成。這些時鐘脈沖信號的時鐘脈沖通過方波時鐘信號的上升時鐘邊沿觸發(fā)。脈沖鎖存器可以用來實施集成電路中的時間借用機(jī)制。時間借用機(jī)制可以允許通過優(yōu)化沿臨界電路路徑的時序性能而提高電路性能。隨著電...
注意:該技術(shù)已申請專利,請尊重研發(fā)人員的辛勤研發(fā)付出,在未取得專利權(quán)人授權(quán)前,僅供技術(shù)研究參考不得用于商業(yè)用途。
該專利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán),增加技術(shù)思路,做技術(shù)知識儲備,不適合論文引用。
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