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技術(shù)編號(hào)：6338663

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本發(fā)明涉及現(xiàn)場(chǎng)可編程門陣列(FPGA)，尤其涉及嵌入式調(diào)試系統(tǒng)復(fù)用現(xiàn)場(chǎng)可編程門陣列(FPGA)內(nèi)部聯(lián)合測(cè)試行動(dòng)組(JTAG)接口和在線設(shè)置寄存器，來(lái)實(shí)現(xiàn)對(duì)現(xiàn)場(chǎng)可編程門陣列(FPGA)內(nèi)部信號(hào)進(jìn)行觀測(cè)的方法。背景技術(shù)在采用現(xiàn)場(chǎng)可編程門陣列(FPGA)等硬件邏輯驗(yàn)證IC設(shè)計(jì)的過(guò)程中，通常需要邏輯分析儀來(lái)觀測(cè)硬件邏輯的內(nèi)部信號(hào)。一種驗(yàn)證方法類似于Altera公司推出的SignalTap 工具，將這些功能代碼和被測(cè)試代碼一起經(jīng)過(guò)邏輯綜合和布線生成配置文件，下載到現(xiàn)...
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