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技術(shù)編號：10807095

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計算機以及各種電子設(shè)備廣泛的應(yīng)用于現(xiàn)代生活的各個方面，對內(nèi)存產(chǎn)品(DRAM存儲器)需求越來越大。人們對速度要求越來越快，存儲器的時鐘就越來越小，系統(tǒng)提供的時鐘受到微小的干擾都會導(dǎo)致輸入時鐘占空比發(fā)生很大變化。而存儲器輸入時鐘占空比的變化極易導(dǎo)致存儲器功能故障。如圖1所示，為高速DRAM存儲器時鐘路徑的基本架構(gòu)，包括輸入時鐘接收器、DLL延遲單元、第一 DCC延遲單元、第二 DCC延遲單元、DCC鑒相器、輸出時鐘生成電路、時鐘路徑反饋電路以及DLL鑒相器；1...
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