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基于插裝標(biāo)簽的核間協(xié)同多線程pmu事件監(jiān)測方法技術(shù)資料下載

技術(shù)編號:9667247

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硬件體系結(jié)構(gòu)的設(shè)計(jì)者為了評測他們的結(jié)構(gòu)設(shè)計(jì),在處理上植入了很多硬件性能計(jì)數(shù)器,這種做法也為利用硬件支持來分析程序的性能影響因素提供了可能。隨著處理器設(shè)計(jì)的不斷改進(jìn)和性能的不斷提升,現(xiàn)代處理器大都集成了一類特殊的硬件性能監(jiān)測單元,即PMU(performance monitoring unit,稱為“性能監(jiān)視單元”或“硬件性能計(jì)數(shù)器”),來收集處理器中的性能事件。例如,如果發(fā)生一次指令Cache(高速緩存)脫靶事件,則PMU的相應(yīng)寄存器通過加一來記錄這一事件...
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