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技術(shù)編號：6816021

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本發(fā)明涉及一種集成電路，特別是一種可避免栓鎖效應(yīng)的集成電路。背景技術(shù) 栓鎖效應(yīng)(latchup)是CMOS IC中很重要的可靠度問題，是一種由寄生PNPN(硅控整流器，SCR)結(jié)構(gòu)導(dǎo)通所形成的一低阻抗?fàn)顟B(tài)。由于電源線與地之間在栓鎖效應(yīng)發(fā)生時，具有一個低的并聯(lián)阻抗，因此，大量的電源線電流就會存在于電源線之間。如果此電流沒有被限制的話，這將導(dǎo)致邏輯錯誤，電路誤動作，或是對IC產(chǎn)生不可回復(fù)的傷害。很不幸地，因?yàn)镻MOS的P+，NMOS的NWELL，P基板、N+將...
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