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一種高速并口接口電路的制作方法

文檔序號(hào):6592360閱讀:251來(lái)源:國(guó)知局
專(zhuān)利名稱(chēng):一種高速并口接口電路的制作方法
技術(shù)領(lǐng)域
本實(shí)用新型涉及并口接口電路,特別涉及高速并口接口電路。
背景技術(shù)
隨著現(xiàn)代信息化的高速發(fā)展,產(chǎn)生、傳輸、處理的信息量呈指數(shù)級(jí)增長(zhǎng),多媒體、 高速處理器、網(wǎng)絡(luò)技術(shù)等對(duì)信號(hào)傳輸速度的要求越來(lái)越高,而并口作為通用電腦的標(biāo)準(zhǔn)配 置接口,由于其引腳眾多、控制功能豐富且獨(dú)立性強(qiáng),在數(shù)據(jù)傳輸領(lǐng)域仍有其不可取代的地 位,而限制并口傳輸速度的一個(gè)重要環(huán)節(jié)就是接口電平轉(zhuǎn)換速度,現(xiàn)有的并口接口電路很 容易使高頻數(shù)據(jù)在接口電平轉(zhuǎn)換的過(guò)程中產(chǎn)生畸變問(wèn)題。

實(shí)用新型內(nèi)容本實(shí)用新型的目的是克服上述現(xiàn)有并口接口電路很容易使高頻數(shù)據(jù)在接口電平 轉(zhuǎn)換的過(guò)程中產(chǎn)生畸變問(wèn)題的缺點(diǎn),提供一種高速并口接口電路。本實(shí)用新型解決其技術(shù)問(wèn)題所采用的技術(shù)方案是,一種高速并口接口電路,包括 并口接口及外設(shè)接口,還包括數(shù)據(jù)電平高速轉(zhuǎn)換電路及供電電路,所述并口接口通過(guò)數(shù)據(jù) 電平高速轉(zhuǎn)換電路與外設(shè)接口連接,供電電路與數(shù)據(jù)電平高速轉(zhuǎn)換電路連接。進(jìn)一步的,所述供電電路包括電壓輸入端、電壓轉(zhuǎn)換電路及3. 3V電壓輸出端,所 述電壓輸入端通過(guò)電壓轉(zhuǎn)換電路與3. 3V電壓輸出端連接。具體的,所述電壓輸入端為USB接口。再進(jìn)一步的,所述并口接口為DB25針式并行接口,可通過(guò)并口延長(zhǎng)線(xiàn)與PC機(jī)標(biāo)準(zhǔn) DB25孔式并口相連。具體的,所述數(shù)據(jù)電平高速轉(zhuǎn)換電路包括集成電路一、集成電路二、集成電路三、 集成電路四、集成電路五、集成電路六、場(chǎng)效應(yīng)管一、場(chǎng)效應(yīng)管二、電容一、電容二、電容三、 電容四、電容五、電容六、電阻一、電阻二、電阻三、電阻四、電阻五、電阻六、電阻七、電阻八、 電阻九、電阻十、電阻十一、電阻十二、電阻十三、電阻十四、電阻十五、電阻十六及地線(xiàn),所 述集成電路一的第二管腳通過(guò)電阻一與并口接口的第二管腳連接,集成電路二的第二管腳 通過(guò)電阻二與并口接口的第四管腳連接,集成電路三的第二管腳通過(guò)電阻三與并口接口 的第三管腳連接,集成電路四的第二管腳與電阻四的一端連接,電阻四的另一端與場(chǎng)效應(yīng) 管二的第二管腳連接,集成電路五的第二管腳與電阻五的一端連接,電阻五的另一端與集 成電路六的第四管腳連接,集成電路六的第二管腳與電阻六的一端連接,電阻六的另一端 與外設(shè)接口的第四管腳連接,并通過(guò)電阻十四與外設(shè)接口的第五管腳連接,集成電路一的 第四管腳與電容一的一端連接,電容一的另一端與地線(xiàn)連接,集成電路二的第四管腳與電 容二的一端連接,電容二的另一端與地線(xiàn)連接,集成電路三的第四管腳與電容三的一端連 接,電容三的另一端與地線(xiàn)連接,集成電路四的第四管腳與電容四的一端連接,電容四的 另一端與地線(xiàn)連接,集成電路五的第四管腳與電容五的一端連接,電容五的另一端與地線(xiàn) 連接,集成電路六的第四管腳與電容六的一端連接,電容六的另一端與地線(xiàn)連接,集成電路一的第四管腳與電阻七的一端連接,電阻七另一端與場(chǎng)效應(yīng)管二的第二管腳連接,集成 電路二的第四管腳與電阻八的一端連接,電阻八另一端與外設(shè)接口的第四管腳連接,并通 過(guò)電阻十四與外設(shè)接口的第五管腳連接,集成電路三的第四管腳與電阻九的一端連接,電 阻九另一端與場(chǎng)效應(yīng)管一的第二管腳連接,集成電路四的第四管腳與電阻十的一端連接, 電阻十的另一端與并口接口的第十管腳連接,集成電路五的第四管腳與電阻十一的一端連 接,電阻十一的另一端與并口接口的第十二管腳連接,集成電路一、集成電路二、集成電路 三、集成電路四、集成電路五、集成電路六的第三管腳都與地線(xiàn)連接,第五管腳都與供電電 路的3. 3V電壓輸出端連接,場(chǎng)效應(yīng)管一的第一管腳與電阻十二的一端連接,電阻十二的另 一端與供電電路的3. 3V電壓輸出端連接,場(chǎng)效應(yīng)管二的第一管腳與電阻十三的一端連接, 電阻十三的另一端與供電電路的3. 3V電壓輸出端連接,場(chǎng)效應(yīng)管一的第三管腳與外設(shè)接 口的第二管腳連接,場(chǎng)效應(yīng)管二的第三管腳與外設(shè)接口的第三管腳連接,電阻十五的一端 與外設(shè)接口的第四管腳連接,另一端與外設(shè)接口的第五管腳連接并與地線(xiàn)連接,電阻十六 的一端與外設(shè)接口的第二管腳連接,另一端與外設(shè)接口的第五管腳連接并與地線(xiàn)連接,并 口接口的第六、第七、第八、第九、第十、第十一、第十二、第十三、第十八、第十九、第二十、第 二十一、第二十二、第二十三、第二十四、第二十五管腳都與地線(xiàn)連接。再進(jìn)一步的,所述集成電路一、集成電路二、集成電路三、集成電路四、集成電路 五、集成電路六的型號(hào)為SN74AUP1G06。本實(shí)用新型的有益效果是,利用上述一種高速并口接口電路,增強(qiáng)了并口數(shù)據(jù)傳 輸能力,IMHZ以上高頻數(shù)據(jù)無(wú)明顯畸變,完全滿(mǎn)足IIC快速模式下400KHZ的傳輸要求,大大 降低了高速數(shù)據(jù)傳輸經(jīng)過(guò)電平轉(zhuǎn)換時(shí)的電平畸變,提高了數(shù)據(jù)接收的穩(wěn)定性,電路設(shè)計(jì)簡(jiǎn) 單,性?xún)r(jià)比高,且利用USB接口進(jìn)行供電,非常方便。

圖1為實(shí)施例1的數(shù)據(jù)電平高速轉(zhuǎn)換電路原理圖。
具體實(shí)施方式

以下結(jié)合附圖及實(shí)施例,詳細(xì)描述本實(shí)用新型的技術(shù)方案。本實(shí)用新型將并口接口通過(guò)數(shù)據(jù)電平高速轉(zhuǎn)換電路與外設(shè)接口連接,供電電路與 數(shù)據(jù)電平高速轉(zhuǎn)換電路連接組成一種高速并口接口電路,這種電路電路設(shè)計(jì)簡(jiǎn)單,性?xún)r(jià)比
尚ο實(shí)施例1本例的高壓靜電發(fā)生裝置,包括并口接口 P1、外設(shè)接口 C0N1、數(shù)據(jù)電平高速轉(zhuǎn)換 電路及供電電路,其中數(shù)據(jù)電平高速轉(zhuǎn)換電路包括集成電路一 IC1、集成電路二 IC2、集成 電路三IC3、集成電路四IC4、集成電路五IC5、集成電路六IC6、場(chǎng)效應(yīng)管一 Q1、場(chǎng)效應(yīng)管二 Q2、電容一 Cl、電容二 C2、電容三C3、電容四C4、電容五C5、電容六C6、電阻一 R1、電阻二 R2、 電阻三R3、電阻四R4、電阻五R5、電阻六R6、電阻七R7、電阻八R8、電阻九R9、電阻十R10、 電阻i^一 Rl 1、電阻十二 Rl2、電阻十三R13、電阻十四R14、電阻十五Rl5、電阻十六R16及地 線(xiàn),以集成電路一 IC1、集成電路二 IC2、集成電路三IC3、集成電路四IC4、集成電路五IC5、 集成電路六IC6均采用SN74AUP1G06型號(hào)的集成電路為例,并口接口以DB25針式并行接口為例,可通過(guò)并口延長(zhǎng)線(xiàn)與電腦標(biāo)準(zhǔn)DB25孔式并口相連,其電路原理圖如圖1。供電電路包括電壓輸入端、電壓轉(zhuǎn)換電路及3. 3V電壓輸出端VCC,其中,電壓輸入端通過(guò)電壓轉(zhuǎn)換電路與3. 3V電壓輸出端VCC連接,且電壓輸入端為USB接口,由USB接口 提供5V電源輸入,通過(guò)電壓轉(zhuǎn)換電路轉(zhuǎn)換成3. 3V的電壓輸出給數(shù)據(jù)電平高速轉(zhuǎn)換電路供 H1^ ο數(shù)據(jù)電平高速轉(zhuǎn)換電路由集成電路一 ICl的第二管腳通過(guò)電阻一 Rl與并口接口 Pl的第二管腳連接,集成電路二 IC2的第二管腳通過(guò)電阻二 R2與并口接口 Pl的第四管腳 連接,集成電路三IC3的第二管腳通過(guò)電阻三R3與并口接口 Pl的第三管腳連接,集成電路 四IC4的第二管腳與電阻四R4的一端連接,電阻四R4的另一端與場(chǎng)效應(yīng)管二 Q2的第二管 腳連接,集成電路五IC5的第二管腳與電阻五R5的一端連接,電阻五R5的另一端與集成電 路六IC6的第四管腳連接,集成電路六IC6的第二管腳與電阻六R6的一端連接,電阻六R6 的另一端與外設(shè)接口 CONl的第四管腳連接,并通過(guò)電阻十四R14與外設(shè)接口 CONl的第五 管腳連接,集成電路一 ICl的第四管腳與電容一 Cl的一端連接,電容一 Cl的另一端與地線(xiàn) 連接,集成電路二 IC2的第四管腳與電容二 C2的一端連接,電容二 C2的另一端與地線(xiàn)連 接,集成電路三IC3的第四管腳與電容三C3的一端連接,電容三C3的另一端與地線(xiàn)連接, 集成電路四IC4的第四管腳與電容四C4的一端連接,電容四C4的另一端與地線(xiàn)連接,集 成電路五IC5的第四管腳與電容五C5的一端連接,電容五C5的另一端與地線(xiàn)連接,集成電 路六IC6的第四管腳與電容六C6的一端連接,電容六C6的另一端與地線(xiàn)連接,集成電路 一 ICl的第四管腳與電阻七R7的一端連接,電阻七R7另一端與場(chǎng)效應(yīng)管二 Q2的第二管腳 連接,集成電路二 IC2的第四管腳與電阻八R8的一端連接,電阻八R8另一端與外設(shè)接口 CONl的第四管腳連接,并通過(guò)電阻十四R14與外設(shè)接口 CONl的第五管腳連接,集成電路三 IC3的第四管腳與電阻九R9的一端連接,電阻九R9另一端與場(chǎng)效應(yīng)管一 Ql的第二管腳連 接,集成電路四IC4的第四管腳與電阻十RlO的一端連接,電阻十RlO的另一端與并口接口 Pl的第十管腳連接,集成電路五IC5的第四管腳與電阻十一 Rll的一端連接,電阻十一 Rll 的另一端與并口接口 Pl的第十二管腳連接,集成電路一 IC1、集成電路二 IC2、集成電路三 IC3、集成電路四IC4、集成電路五IC5、集成電路六IC6的第三管腳都與地線(xiàn)連接,第五管腳 都與供電電路的3. 3V電壓輸出端VCC連接,場(chǎng)效應(yīng)管一 Ql的第一管腳與電阻十二 R12的 一端連接,電阻十二 R12的另一端與供電電路的3. 3V電壓輸出端VCC連接,場(chǎng)效應(yīng)管二 Q2 的第一管腳與電阻十三R13的一端連接,電阻十三R13的另一端與供電電路的3. 3V電壓輸 出端VCC連接,場(chǎng)效應(yīng)管一 Ql的第三管腳與外設(shè)接口 CONl的第二管腳連接,場(chǎng)效應(yīng)管二 Q2的第三管腳與外設(shè)接口 CONl的第三管腳連接,電阻十五R15的一端與外設(shè)接口 CONl的 第四管腳連接,另一端與外設(shè)接口 CONl的第五管腳連接并與地線(xiàn)連接,電阻十六R16的一 端與外設(shè)接口 CONl的第二管腳連接,另一端與外設(shè)接口 CONl的第五管腳連接并與地線(xiàn)連 接,并口接口 Pl的第六、第七、第八、第九、第十、第十一、第十二、第十三、第十八、第十九、 第二十、第二十一、第二十二、第二十三、第二十四、第二十五管腳都與地線(xiàn)連接組成。數(shù)據(jù)電平高速轉(zhuǎn)換電路將并口接口 Pl第二管腳的SDA OUT數(shù)據(jù)信號(hào)經(jīng)過(guò)集成電 路ICl反向后與外設(shè)接口 CONl的第三管腳(FPGA SDA)連接,另一方面FPGA SDA數(shù)據(jù)信號(hào) 經(jīng)過(guò)集成電路四IC4反向與并口接口 Pl的第十管腳(SDA IN)連接,實(shí)現(xiàn)SDA數(shù)據(jù)信號(hào)的 雙向通訊;并口接口 Pl的第三管腳的SCL時(shí)鐘信號(hào)經(jīng)過(guò)集成電路三IC3反向后與外設(shè)接口 CONl的第二管腳(FPGASCL)連接,SCL時(shí)鐘信號(hào)由并口端主控同步;并口接口Pl的第四 管腳的BUS OUT控制信號(hào)經(jīng)過(guò)集成電路二 IC2反向后與外設(shè)接口 CONl的第四管腳(FPGA BUS)連接,另一方面FPGA BUS控制信號(hào)經(jīng)過(guò)集成電路六IC6、集成電路五IC5反向兩次后 與并口接口 Pl的第十二管腳(BUSIN)連接,實(shí)現(xiàn)BUS控制信號(hào)的雙向通信。
權(quán)利要求一種高速并口接口電路,包括并口接口及外設(shè)接口,其特征在于,還包括數(shù)據(jù)電平高速轉(zhuǎn)換電路及供電電路,所述并口接口通過(guò)數(shù)據(jù)電平高速轉(zhuǎn)換電路與外設(shè)接口連接,供電電路與數(shù)據(jù)電平高速轉(zhuǎn)換電路連接。
2.根據(jù)權(quán)利要求1所述一種高速并口接口電路,其特征在于,所述供電電路包括電壓 輸入端、電壓轉(zhuǎn)換電路及3. 3V電壓輸出端,所述電壓輸入端通過(guò)電壓轉(zhuǎn)換電路與3. 3V電壓 輸出端連接。
3.根據(jù)權(quán)利要求2所述一種高速并口接口電路,其特征在于,所述電壓輸入端為USB接
4.根據(jù)權(quán)利要求2所述一種高速并口接口電路,其特征在于,所述并口接口為DB25針 式并行接口。
5.根據(jù)權(quán)利要求4所述一種高速并口接口電路,其特征在于,所述數(shù)據(jù)電平高速轉(zhuǎn)換 電路包括集成電路一、集成電路二、集成電路三、集成電路四、集成電路五、集成電路六、場(chǎng) 效應(yīng)管一、場(chǎng)效應(yīng)管二、電容一、電容二、電容三、電容四、電容五、電容六、電阻一、電阻二、 電阻三、電阻四、電阻五、電阻六、電阻七、電阻八、電阻九、電阻十、電阻i^一、電阻十二、電 阻十三、電阻十四、電阻十五、電阻十六及地線(xiàn),所述集成電路一的第二管腳通過(guò)電阻一與 并口接口的第二管腳連接,集成電路二的第二管腳通過(guò)電阻二與并口接口的第四管腳連 接,集成電路三的第二管腳通過(guò)電阻三與并口接口的第三管腳連接,集成電路四的第二管 腳與電阻四的一端連接,電阻四的另一端與場(chǎng)效應(yīng)管二的第二管腳連接,集成電路五的第 二管腳與電阻五的一端連接,電阻五的另一端與集成電路六的第四管腳連接,集成電路六 的第二管腳與電阻六的一端連接,電阻六的另一端與外設(shè)接口的第四管腳連接,并通過(guò)電 阻十四與外設(shè)接口的第五管腳連接,集成電路一的第四管腳與電容一的一端連接,電容一 的另一端與地線(xiàn)連接,集成電路二的第四管腳與電容二的一端連接,電容二的另一端與地 線(xiàn)連接,集成電路三的第四管腳與電容三的一端連接,電容三的另一端與地線(xiàn)連接,集成 電路四的第四管腳與電容四的一端連接,電容四的另一端與地線(xiàn)連接,集成電路五的第四 管腳與電容五的一端連接,電容五的另一端與地線(xiàn)連接,集成電路六的第四管腳與電容六 的一端連接,電容六的另一端與地線(xiàn)連接,集成電路一的第四管腳與電阻七的一端連接, 電阻七另一端與場(chǎng)效應(yīng)管二的第二管腳連接,集成電路二的第四管腳與電阻八的一端連 接,電阻八另一端與外設(shè)接口的第四管腳連接,并通過(guò)電阻十四與外設(shè)接口的第五管腳連 接,集成電路三的第四管腳與電阻九的一端連接,電阻九另一端與場(chǎng)效應(yīng)管一的第二管腳 連接,集成電路四的第四管腳與電阻十的一端連接,電阻十的另一端與并口接口的第十管 腳連接,集成電路五的第四管腳與電阻十一的一端連接,電阻十一的另一端與并口接口的 第十二管腳連接,集成電路一、集成電路二、集成電路三、集成電路四、集成電路五、集成電 路六的第三管腳都與地線(xiàn)連接,第五管腳都與供電電路的3. 3V電壓輸出端連接,場(chǎng)效應(yīng) 管一的第一管腳與電阻十二的一端連接,電阻十二的另一端與供電電路的3. 3V電壓輸出 端連接,場(chǎng)效應(yīng)管二的第一管腳與電阻十三的一端連接,電阻十三的另一端與供電電路的 3. 3V電壓輸出端連接,場(chǎng)效應(yīng)管一的第三管腳與外設(shè)接口的第二管腳連接,場(chǎng)效應(yīng)管二的 第三管腳與外設(shè)接口的第三管腳連接,電阻十五的一端與外設(shè)接口的第四管腳連接,另一 端與外設(shè)接口的第五管腳連接并與地線(xiàn)連接,電阻十六的一端與外設(shè)接口的第二管腳連 接,另一端與外設(shè)接口的第五管腳連接并與地線(xiàn)連接,并口接口的第六、第七、第八、第九、第十、第十一、第十二第十三、第十八、第十九、第二十、第二十一、第二十二、第二十三、第二十四、第二十五管腳都與地線(xiàn)連接。
6.根據(jù)權(quán)利要求5所述一種高速并口接口電路,其特征在于,所述集成電路一、集成電 路二、集成電路三、集成電路四、集成電路五、集成電路六的型號(hào)為SN74AUP1G06。
專(zhuān)利摘要本實(shí)用新型涉及并口接口電路。本實(shí)用新型解決了現(xiàn)有并口接口電路很容易使高頻數(shù)據(jù)在接口電平轉(zhuǎn)換的過(guò)程中產(chǎn)生畸變的問(wèn)題,提供了一種高速并口接口電路,其技術(shù)方案是一種高速并口接口電路,包括并口接口及外設(shè)接口,還包括數(shù)據(jù)電平高速轉(zhuǎn)換電路及供電電路,所述并口接口通過(guò)數(shù)據(jù)電平高速轉(zhuǎn)換電路與外設(shè)接口連接,供電電路與數(shù)據(jù)電平高速轉(zhuǎn)換電路連接。本實(shí)用新型的有益效果是大大降低了高速數(shù)據(jù)傳輸經(jīng)過(guò)電平轉(zhuǎn)換時(shí)的電平畸變,提高了數(shù)據(jù)接收的穩(wěn)定性,適用于并口接口。
文檔編號(hào)G06F13/38GK201562273SQ200920315269
公開(kāi)日2010年8月25日 申請(qǐng)日期2009年11月20日 優(yōu)先權(quán)日2009年11月20日
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